3VM1112-4EE32-0AA0西门子模块

时间：2023-04-20

断路器 3VM1 IEC 框架 160 通断能力等级 S Icu=36 kA @ 415 V 3 ，系统保护 TM220，ATFM，In=125A 过载保护 Ir=88A - 125A 短路保护 Ii=10 x In 螺钉扁形连接器

西门子plc梯形图语言沿袭了继电器控制电路的形式，梯形图是在常用的继电器与接触器逻辑控制基础上简化了符号演变而来的，下面我们来看看plc梯形图编程时应遵守的一些规则：

1)每个梯形图的程序段都必须以输出线圈或指令框( Box)结束，比较指令框(相当于触点)、中线输出线圈和上升沿、下降沿线圈不能用于程序段结束。

2)指令框的使能输出端“ENO”可以和右边的指令框的使能输入端“EN”连接。

3)下列线圈要求布尔逻辑，即必须用触点电路控制它们，它们不能与左侧垂直“电源线”直接相连：输出线圈、置位(S)线圈和复位(R)线圈;中线输出线圈和上升沿、下降沿线圈;计数器和定时器线圈;逻辑非跳转( JMPN);主控继电器接通(MCR<);将RLO存入BR存储器的SAVE线圈和返回线圈(RET)。

下面的线圈不允许布尔逻辑，即这些线圈必须与左侧垂直“电源线”直接相连：主控继电器( MCRA);主控继电器关闭(MCRD)和打开数据块(OPN)。

其他线圈既可以用布尔逻辑操作也可以不用。

4)下列线圈不能用于并联输出：逻辑非跳转( JMPN)、跳转(JMP)、调用(CALL)和返回( RET)。

5)如果分支中只有一个元件，删除这个元件时，整个分支也同时被删掉：删除一个指令框时，该指令框除主分支外所有的布尔输入分支都将同时被删除。

6)不允许生成引起短路的分支。

6ES7211-1BE40-0XB0	CPU 1211C AC/DC/Rly,6输入/4输出,集成2AI
6ES7211-1AE40-0XB0	CPU 1211C DC/DC/DC,6输入/4输出,集成2AI
6ES7211-1HE40-0XB0	CPU 1211C DC/DC/Rly,6输入/4输出,集成2AI
6ES7212-1BE40-0XB0	CPU 1212C AC/DC/Rly,8输入/6输出,集成2AI
6ES7212-1AE40-0XB0	CPU 1212C DC/DC/DC,8输入/6输出,集成2AI
6ES7212-1HE40-0XB0	CPU 1212C DC/DC/Rly,8输入/6输出,集成2AI
6ES7214-1BG40-0XB0	CPU 1214C AC/DC/Rly,14输入/10输出,集成2AI
6ES7214-1AG40-0XB0	CPU 1214C DC/DC/DC,14输入/10输出,集成2AI
6ES7214-1HG40-0XB0	CPU 1214C DC/DC/Rly,14输入/10输出,集成2AI
6ES7215-1BG40-0XB0	CPU 1215C AC/DC/Rly,14输入/10输出,集成2AI/2AO
6ES7215-1AG40-0XB0	CPU 1215C DC/DC/DC,14输入/10输出,集成2AI/2AO
6ES7215-1HG40-0XB0	CPU 1215C DC/DC/Rly,14输入/10输出,集成2AI/2AO
6ES72171AG400XB0	CPU 1217C DC/DC/DC,14输入/10输出,集成2AI/2AO

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