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时间：2018-12-25

缓冲器：在CPU的设计中，一般输出线的直流负载能力可以驱动一个TTL负载，而在连接中，CPU的一根地址线或数据线，可能连接多个存储器芯片，但存储器芯片都为MOS电路，主要是电容负载，直流负载远小于TTL负载。故小型系统中，CPU可与存储器直接相连，在大型系统中就需要加缓冲器任何程序或数据要为CPU所使用，必须先放到主存储器(内存)中，即CPU只与主存交换数据，所以主存的速度在很大程度上决定了系统的运行速度。程序在运行期间，在一个较短的时间间隔内，由程序产生的地址往往集中在存储器的一个很小范围的地址空间内。指令地址本来就是连续分布的，再加上循环程序段和子程序段要多次重复执行，因此对这些地址中的内容的访问就自然的具有时间集中分布的倾向。数据分布的集中倾向不如程序这么明显，但对数组的存储和访问以及工作单元的选择可以使存储器地址相对地集中。这种对局部范围的存储器地址频繁访问，而对此范围外的地址访问甚少的现象被称为程序访问的局部化(Locality of Reference)性质。由此性质可知，在这个局部范围内被访问的信息集合随时间的变化是很缓慢的，如果把在一段时间内一定地址范围被频繁访问的信息集合成批地从主存中读到一个能高速存取的小容量存储器中存放起来，供程序在这段时间内随时采用而减少或不再去访问速度较慢的主存，就可以加快程序的运行速度。这个介于CPU和主存之间的高速小容量存储器就称之为高速缓冲存储器，简称Cache。不难看出，程序访问的局部化性质是Cache得以实现的原理基础。同理，构造磁盘高速缓冲存储器(简称磁盘Cache)，也将提高系统的整体运行速度CPU一般设有一级缓存(L1 Cache)和二级缓存(L2 Cache)。一级缓存是由CPU制造商直接做在CPU内部的，其速度较快，但容量较小，一般只有十几K。PⅡ以前的PC一般都是将二级缓存做在主板上，并且可以人为升级，其容量从256KB到1MB不等，而PⅡ CPU则采用了全新的封装方式，把CPU内核与二级缓存一起封装在一只金属盒内，并且不可以升级。二级缓存一般比一级缓存大一个数量级以上，另外，在CPU中，已经出现了带有三级缓存的情况。高速缓冲存储器，即Cache。我们知道，数据分布的集中倾向不如程序这么明显，如果把在一段时间内一定地址范围被频繁访问的信息集合成批地从主的系统中，CPU访问数据时，在Cache中能直接找到的概率，它是Cache的一个重要指标，与Cache的大小、替换算法、程序特性等因素有关。增加Cache后，CPU访问主存的速度是可以预算的，64KB的Cache可以缓冲4MB的主存，且*都在90%以上。以主频为100MHz的CPU(时钟周期约为10ns)、20ns的Cache、70ns的RAM、*为90%计算，CPU访问主存的周期为:有Cache时，20×0.9+70×0.1=34ns;无Cache时，70×1=70ns。由此可见，加了Cache后，CPU访问主存的速度大大提高了，但有一点需注意，加Cache只是加快了CPU访问主存的速度，而CPU访问主存只是计算机整个操作的一部分，所以增加Cache对系统整体速度只能提高10~20%左右

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轴套是套在转轴上的筒状机械零件，是滑动轴承的一个组成部分。一般来说，轴套与轴承座采用过盈配合，而与轴采用间隙配合。轴瓦相当于滑动轴承的外环，轴套是整体的，并且相对轴是运动的，而轴瓦有的是分片的，相对轴是旋转的。在LEGO Mindstorms 系列与BioTrans RoSys系列机器人组件中轴套特指银灰色的乐高标准轴固定器，分全轴套和1/2轴套两种。各大水利发电机组上的各类轴套，主要材料有ZQA
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分配器（英语：allocator）是C++标准库的重要组成部分。C++的库中定义了多种被统称为“容器”的数据结构（如链表、集合等），这些容器的共同特征之一，就是其大小可以在程序的运行时改变；为了实现这一点，进行动态内存分配就显得尤为必要，在此分配器就用于处理容器对内存的分配与释放请求。换句话说，分配器用于封装STL容器在内存管理上的低层细节。默认情况下，C++标准库使用其自带的通用分配器，但根据具
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选用接点金属时需考虑其对抗腐蚀的程度，因为大多数金属氧化后会形成绝缘的氧化物，使接点无法正常工作。选用接点金属也需考虑其电导率、硬度、机械强度、成本及是否有毒等因素。有时会在接点上电镀抗腐蚀金属。一般会镀在接点的接触面，以避免因氧化物而影响其性能。有时接触面也会使用非金属的导电材料，如导电塑胶。开关中除了接点之外，也会有可动件使接点导通或不导通，开关可依可动件的不同为分为杠杆开关（Toggle s